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http://ir.hust.edu.tw/dspace/handle/310993100/584
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| 題名: | 具低雜訊之輸出緩衝電路 OUTPUT BUFFER WITH REDUCED NOISE |
| 作者: | 蕭明椿 |
| 貢獻者: | 修平技術學院 |
| 日期: | 2005-10-01
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| 上傳時間: | 2008-11-06T08:23:01Z
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| 摘要: | 本發明提出一種新穎之具低雜訊的輸出緩衝電路，其不但電路結構簡單，並且也可有效防止接地電壓位準浮動以及避免雜訊的發生，同時，亦可提升整個晶片之穩定度。該輸出緩衝電路主要係包含一由PMOS電晶體 M1以及NMOS電晶體M2所組成的CMOS反相器、一第一NPN電晶體 Q1、一第二NPN電晶體Q2、以及一延遲電路1。當輸入信號IN由高位準變為低位準時，延遲電路所提供之延遲時間，可使得CMOS反相器中之 NMOS電晶體M2仍能導通一段時間，藉此可吸走部份的PMOS電晶體 M1之汲極電流，並使得第一NPN電晶體Q1的基極電流減少，從而減少瞬間流經第二NPN電晶體Q2之集極電流(即輸出電流)，結果，輸出電流的電流變化率變得較緩和，並且輸出電流的最大值變得更小，因此不但可有效抑制接地端所感應之瞬間電位差，並且可避免接地電壓位準的浮動以及雜訊的發生，同時亦可提升整個晶片之穩定度。 |
| 顯示於類別: | [電機工程系(含碩士班)] 專利
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描述 |
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